《數字邏輯電路基礎與計算機繫統集成技術》是以eda技術研究為出發點,專門針對計算機科學與技術專業而編寫的硬件技術基礎教程。與以往的數字電路教材不同,《數字邏輯電路基礎與計算機繫統集成技術》重點體現“軟件設計實現硬件技術”的理念,除了在傳統基礎上利用真值表、狀態圖、卡諾圖化簡進行組合邏輯電路、時序邏輯電路設計外,還專門介紹了quartusⅱ9.1開發環境和硬件設計語言verilog
hdl,並使用verilog
hdl語言實現組合電路設計、同步,異步時序電路設計,芯片擴展應用,pld設計,接口電路設計,數字繫統fpga項目設計及簡單微處理器設計等,其他內容還包括邏輯門實現、組合邏輯電路和時序邏輯電路分析、存儲器設計與擴展、脈衝發生器設計、a/d和d/a轉換電路、數字繫統設計等。在設計分析中,能夠把設計的電路芯片與計算機繫統有機地結合起來。
《數字邏輯電路基礎與計算機繫統集成技術》可作為高等院校本科生的教材,還可作為技術開發人員的參考資料。