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  • 數字繫統測試和可測性設計(影印版)/國外大學優秀教材
    該商品所屬分類:研究生 -> 工學
    【市場價】
    321-467
    【優惠價】
    201-292
    【作者】 阿布拉莫維奇,布魯爾,弗裡德曼 
    【所屬類別】 圖書  教材  研究生/本科/專科教材  工學圖書  計算機/網絡  影印版圖書  計算機/網絡  計算機教材 
    【出版社】清華大學出版社 
    【ISBN】9787302077473
    【折扣說明】一次購物滿999元台幣免運費+贈品
    一次購物滿2000元台幣95折+免運費+贈品
    一次購物滿3000元台幣92折+免運費+贈品
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    內容介紹



    紙張:膠版紙
    包裝:平裝
    是否套裝:否

    國際標準書號ISBN:9787302077473
    叢書名:國外大學優秀教材——微電子類繫列
    作者:阿布拉莫維奇,布魯爾,弗裡德曼

    出版社:清華大學出版社
    出版時間:2004年01月 

        
        
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    內容簡介
    Digital Systems Testing and Testable Design一書,是全美大學生和研究生優秀教材,比較繫統地介紹了結構測試的理論和方法、可測性設計理論和度量方法、測試數據的處理及簡化的理論和方法以及智能芯片(處理器、數字信號處理器和自動機等)測試理論和方法等。該書共有15章,分為3部分。前8章為部分,主要介紹數字繫統、數字微繫統芯片缺陷的來源、邏輯描述的方法——故障的建模、故障模擬、測試單固定故障、測試橋接故障、智能數字繫統的功能測試及其範圍等;第9章~第14章是第二部分,主要介紹數字繫統的可測性設計理論和方法、建內自測試BIST測試數據壓縮方法等現代測試理論和方法;第15章足第三部分,主要討論繫統測試的方法。該書概念清晰層次分明、定義和證明準確、算法推導和闡述簡練。每章附有大量練習題可幫助讀者對於概念的消化吸收。
    目錄
    PREFACE
    How This Book Was Written
    1.INTRODUCTION
    2.MODELING
    2.1 Basic concepts
    2.2 Functional Modeling at Logic level
    2.2.1 Truth Tables and Primitive Cubes
    2.2.2 State Tables and Flow Tables
    2.2.3 Binary Deision Diagrams
    2.2.4 Programs as Functional Models
    2.3 functional Modeling at the Register Level
    2.3.1 Basic RTL Constructs
    2.3.2 Timing Modeling in RTLs
    2.3.3 Internal RTL ModelsPREFACE
    How This Book Was Written
    1.INTRODUCTION
    2.MODELING
    2.1 Basic concepts
    2.2 Functional Modeling at Logic level
    2.2.1 Truth Tables and Primitive Cubes
    2.2.2 State Tables and Flow Tables
    2.2.3 Binary Deision Diagrams
    2.2.4 Programs as Functional Models
    2.3 functional Modeling at the Register Level
    2.3.1 Basic RTL Constructs
    2.3.2 Timing Modeling in RTLs
    2.3.3 Internal RTL Models
    2.4 Structural Models
    2.4.1 External Representation
    2.4.2 Structural Properties
    2.4.3 Internal Representation
    2.4.4 Wired Logic and Bibirectionality
    2.5 level of Modeling
    REFERENCES
    PROBLEMS
    3.LOGIC SIMULATION
    3.1 Applications
    3.2 Problems in simulation-Based Design Verification
    3.3 Type of simulation
    3.4 The Unknown Logic Value
    3.5 compiled simulation
    3.6 Event-Driven Simulation
    3.7 Delay Models
    3.7.1 Delay Modeling for Gates
    3.7.2 Dealy Modeling for Functional Elements
    3.7.3 Delay Modeling in RTLs
    3.7.4 Other Aspects of Delay Modeling
    3.8 Elemnent Evaluation
    3.9 Hazard Detection
    3.10 Gate-Level Event-Driven simulation
    3.11 Simulation Engines
    REFERENCES
    PROBLEMS
    4. FAULT MODELING
    5.FAULT SIMULATION
    6.TESTING FOR SINGLE STUCK FAULTS
    7.TESTING FOR BRIDGING FAULTS
    8.FUNCTIONAL TESTING
    9.DESING FOR TESTABILITY
    10.COMPRESSION TECHNIQUES
    11.BUILT-IN SELF-TEST
    12.LOGIC-LEVEL DIAGNOSIS
    13.SELF-CHECKING DESIGN
    14.PLA TESTING
    15.SYSTEM-LEVEL DIAGNOSIS
    INDEX


     
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