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  • 基於Verilog的FPGA設計基礎——國家自然科學基金資助
    該商品所屬分類:計算機/網絡 -> 硬件
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    【作者】 杜慧敏 
    【所屬類別】 圖書  教材  征訂教材  高等理工圖書  計算機/網絡  硬件外部設備維修圖書  計算機/網絡  計算機教材 
    【出版社】西安電子科技大學出版社 
    【ISBN】9787560616261
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    內容介紹



    紙張:膠版紙
    包裝:平裝
    是否套裝:否

    國際標準書號ISBN:9787560616261
    叢書名:國家自然科學基金資助
    作者:杜慧敏

    出版社:西安電子科技大學出版社
    出版時間:2006年02月 

        
        
    "

    內容簡介
    本書簡要介紹了FPGA的編程技術,詳細討論了以Altera FPGA為代表的可編程器件的結構和特點、Altera QuartusⅡ集成環境的使用以及目前工業界常用的仿真工具Modelsim的使用。重點講授了FPGA設計流程中的基本概念、所采用的步驟和應該遵循的原則,包括模塊劃分原則、可綜合Verilog編碼風格、驗證程序的編寫方法和靜態時序分析等。另外,本書結合Altera公司的NiosⅡ軟核,簡單介紹了基於SOPC的繫統設計方法以及Altera SOPC Builder軟件的使用方法。
    本書可作為從事數字集成電路設計及相關工程技術人員的參考書,也可作為大專院校電子信息、自動控制等專業高年級本科生及研究生的教學用書。
    目錄
    第1章 緒論
    1.1 FPGA概述
    1.1.1 FPGA發展的簡要回顧
    1.1.2 FPGA與ASIC
    1.2 可編程邏輯器件的基本概念
    1.3 簡單可編程器件(SPLD)的結構
    1.4 高密度可編程邏輯器件
    1.4.1 復雜可編程邏輯器件CPLD
    1.4.2 現場可編程門陣列FPGA
    1.4.3 CPLD和FPGA的區別
    1.4.4 FPGA/CPLD廠家簡介
    1.5 基於FPGA的設計流程與設計方法
    1.5.1 基於FPGA的設計流程
    1.5.2 自頂向下和自底向上的設計方法學第1章 緒論
    1.1 FPGA概述
    1.1.1 FPGA發展的簡要回顧
    1.1.2 FPGA與ASIC
    1.2 可編程邏輯器件的基本概念
    1.3 簡單可編程器件(SPLD)的結構
    1.4 高密度可編程邏輯器件
    1.4.1 復雜可編程邏輯器件CPLD
    1.4.2 現場可編程門陣列FPGA
    1.4.3 CPLD和FPGA的區別
    1.4.4 FPGA/CPLD廠家簡介
    1.5 基於FPGA的設計流程與設計方法
    1.5.1 基於FPGA的設計流程
    1.5.2 自頂向下和自底向上的設計方法學
    1.5.3 基於IP核的設計
    1.6 EDA技術簡介
    第2章 可編程邏輯器件
    2.1 Altera器件概述
    2.1.1 FPGA繫列簡介
    2.1.2 EPLD繫列簡介
    2.1.3 結構化ASIC器件
    2.1.4 FPGA器件的配置芯片
    2.2 Altera的EPLD器件繫列
    2.2.1 EPLD器件的特性
    2.2.2 MAX9000器件的結構
    2.2.3 MAXⅡ器件的結構
    2.3 Altera的FPGA器件
    2.3.1 簡單FPGA器件
    2.3.2 復雜FPGA器件
    2.3.3 新型FPGA器件
    2.4 Xilinx公司產品簡介
    2.4.1 Xilinx CPLD器件
    2.4.2 Xilinx FPGA器件的特性
    2.4.3 Xilinx FPGA器件的結構
    2.5 Lattice公司產品簡介
    2.5.1 Lattice CPLD 器件繫列
    2.5.2 Lattice FPGA 產品繫列
    2.5.3 FPSC產品繫列
    2.5.4 低密度 PLD 產品繫列
    2.5.5 其他產品
    2.6 Actel公司產品簡介
    2.6.1 Flash FPGA器件
    2.6.2 反熔絲FPGA器件
    2.6.3 航空航天和軍用器件
    第3章 FPGA設計入門
    3.1 繫統的抽像層次與高級硬件描述語言Verilog
    3.2 用Verilog語言建立數字電路模型
    3.2.1 代碼的書寫風格
    3.2.2 可綜合代碼的編碼風格
    3.2.3 時序電路的設計
    3.3 模塊設計
    3.4 繫統規範
    3.4.1 繫統規範的內容
    3.4.2 選擇FPGA
    第4章 設計驗證
    4.1 驗證綜述
    4.1.1 驗證的概念
    4.1.2 驗證和測試
    4.1.3 自頂向下和自底向上的驗證方法
    4.1.4 主要驗證技術
    4.1.5 驗證工具的介紹
    4.1.6 驗證計劃和流程
    4.2 功能驗證
    4.2.1 驗證程序(Testbench)的組成
    4.2.2 實用構造Testbench技術
    4.3 基於斷言的驗證
    4.4 時序驗證
    4.4.1 靜態時序分析概述
    4.4.2 靜態時序分析中的基本概念
    4.4.3 假路徑和多周期路徑
    4.4.4 時序驗證中的繫統任務
    第5章 ModelSim工具介紹
    ……
    第6章 Quartus集成環境
    第7章 FPGA設計實例
    第8章 Altera繫統級的SOPC開發
    附錄 頻率計繫統的設計
    參考文獻


     
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